Intel® FPGA IP para PCIe
El protocolo PCI Express (PCIe*) es un protocolo serial de alto desempeño, escalable y con grandes funciones con velocidades de transferencia de datos de 2,5 gigatransfer por segundo (GT/s) a 32 GT/s y más. La propiedad intelectual (PI) de Intel FPGA para PCIe sigue escalando a medida que la organización PCI-SIG ofrece especificaciones de la próxima generación. Intel ha sido miembro de PCI-SIG desde 1992 y, con cada generación de silicio, Intel sigue participando en talleres de cumplimiento PCI-SIG para garantizar la interoperabilidad y la conformidad con los estándares de la industria actual.
Las soluciones de PI de PCIe incluyen una pila de protocolos protegidos de PCIe, que incluye las capas de transacciones y de enlace de datos, así como una capa física reforzada. Esta última incluye tanto la conexión al medio físico (PMA) como la subcapa de codificación física (PCS). Nuestra cartera de PI PCIe también incluye bloques de PI blanda opcionales, como los motores de acceso directo a memoria (DMA) y el conmutador PCIe. Esta combinación única de IP reforzada y blanda ofrece un desempeño y flexibilidad superior para una integración óptima.
Intel FPGA IP soluciones de PI de PCIe basadas en funciones han evolucionado con la hoja de ruta del protocolo de PCI-SIG.
- Compatibilidad con hasta PCIe 4.0 x8 con GTS PCIe Hard IP ›
- Compatibilidad con hasta PCIe 5.0 x16 con IP físico PCIe R-Tile ›
- Compatibilidad con hasta PCIe 4.0 x16 y Ethernet 400G con IP dura PCIe F-Tile ›
- Compatibilidad con hasta PCIe 4.0 x16 con IP físico PCIe P-Tile ›
- Compatibilidad con hasta PCIe 3.0 x16 con PI física de PCIe en L/H-tile ›
- Es compatible con hasta 3x8 con PI física en dispositivos Arria® 10 y Cyclone® 10 ›
Nuestras IP blandas complementarias funcionan con las IP duras de PCIe mencionadas anteriormente para realizar las funciones DMA y conmutador de PCIe.
- Agilex™ 5 FPGA – IP DMA (interfaz AXI-Stream) multicanal de GTS AXI disponible para complementar la IP física de GTS PCIe ›
- Agilex™ 7 FPGA – AXI Multichannel DMA IP (interfaz axi-Stream) disponible para complementar la IP dura de PCIe R-Tile ›
- Agilex™ 7 y Stratix® 10 FPGAs – IP DMA multicanal (interfaces AVMM / AVST) disponible para complementar la IP dura de PCIe H-Tile (Stratix® 10)/P-Tile/F-Tile/R-Tile ›
- IP de conmutador PCIe escalable disponible para complementar la PI dura de PCIe P-Tile/F-Tile/R-Tile ›
Compatibilidad con dispositivos y cantidad de bloques de IP de PCIe
Familia de dispositivos |
Cantidad de bloques de PI de PCIe |
Velocidad del enlace de PCIe 1.0 (2,5 GT/s) |
Velocidad del enlace de PCIe 2,0 (5,0 GT/s) |
Velocidad del enlace de PCIe 3,0 (8,0 GT/s) |
Velocidad del enlace de PCIe 4,0 (16,0 GT/s) |
Velocidad del enlace de PCIe 5,0 (32,0 GT/s) |
|---|---|---|---|---|---|---|
| Agilex™ 7 | de 1 a 4 por dispositivo | ✓ | ✓ | ✓ | ✓ | ✓ |
| Agilex™ 5 | 1 - 4 por dispositivo | ✓ | ✓ | ✓ | ✓ | |
| Agilex™ 3 | 1 por dispositivo | ✓ | ✓ | ✓ | ||
| Stratix® 10 | de 1 a 4 por dispositivo | ✓ | ✓ | ✓ | ✓ |
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| 10 | de 1 a 4 por dispositivo | ✓ | ✓ | ✓ |
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| Cyclone® 10 | 1 por dispositivo | ✓ | ✓ |
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| Cyclone® 10 GX | 1 por dispositivo | ✓ | ✓ |
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| Arria® V | de 1 a 2 por dispositivo | ✓ | ✓ |
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| Cyclone® V GT | 2 por dispositivo | ✓ | ✓ |
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| Cyclone® V GX | de 1 a 2 por dispositivo | ✓ |
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| Stratix® IV | de 2 a 4 por dispositivo | ✓ | ✓ |
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| Cyclone® IV GX | 1 por dispositivo | ✓ |
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| Arria® II GZ | 1 por dispositivo | ✓ | ✓ |
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| Arria® II GX | 1 por dispositivo | ✓ |
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Recursos adicionales
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