PI de DMA de varios canales de PCIe* y PI de puente AVMM
El DMA de varios canales para IP de PCIe le permite transferir datos de manera eficiente entre el host y el dispositivo. El DMA de varios canales para IP de PCIe es compatible con varios canales de DMA entre el host y el dispositivo en el enlace PCIe* subyacente.
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PI de DMA de varios canales de PCIe* y PI de puente AVMM
Un canal DMA consiste en un par de cola de Host a dispositivo (H2D) y Dispositivo a host. Como se muestra en la imagen, el DMA de varios canales para PI de PCIe se puede usar en la infraestructura de hardware de un servidor para permitir la comunicación entre diferentes clientes, basados en máquina virtual (VM), y sus homólogos, basados en dispositivos FPGA. El DMA de varios canales para PCIe funciona en una configuración de cola basada en descriptores con software controlador para transferir datos entre el FPGA local y el host. El DMA de varios canales para la lógica de control de PI de PCIe lee los descriptores de cola y los ejecuta. Las colas separadas se usan para operaciones de D2H y H2D para cada canal. El DMA de varios canales para PI de PCIe integra la PI física de Intel® PCIe y las interfaces, con el complejo de raíz del host a través del enlace PCIe. En el lado de la lógica de usuario, el mapeado de memoria Avalon® y las interfaces de transmisión de la IP permiten una integración fácil de la IP MCDMA con otros componentes del diseñador de plataformas.
La PI de DMA de varios canales también incorpora la funcionalidad de puente de la memoria mapeada Avalon® (AVMM) para las configuraciones de punto de conexión y puerto raíz, como se muestra en la imagen. Los usuarios pueden aprovechar la funcionalidad de puente de manera independiente o en conjunto con el módulo MCDMA.
Funciones
- Opción para seleccionar la interfaz de memoria mapeada Avalon® o la interfaz de lógica de usuario de la interfaz de transmisión Avalon®.
- Compatible con hasta 2048 canales con compatibilidad con SR-IOV (8 PF/VF 2K).
- Arquitectura integrada para evitar el bloqueo del encabezado de línea en todos los canales.
- Aviso de culminación por descriptor con Writeback o MSI
- Compatibilidad con el valor máximo del tamaño de carga de 512 bytes.
- Compatibilidad con el reordenamiento de la culminación.
Estado de IP
Estado de pedido |
Producción |
Códigos de pedido |
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Intel® FPGA IP de DMA de múltiples canales para PCI Express |
H-Tile: IP-PCIEMCDMA P-Tile: IP-PCIEMCDMA F-Tile: IP-PCIEMCDMA |
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