ID del artículo: 000074146 Tipo de contenido: Información y documentación sobre productos Última revisión: 23/08/2023

¿Cómo inserto un búfer LVDS entre un Altera_PLL y ALTLVDS_RX o megafunción ALTLVDS_TX en modo PLL externo para dispositivos Cyclone® V, Arria® V y Stratix® V?

Entorno

    Edición de suscripción de Intel® Quartus® II
    PLL
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descripción

Se requiere insertar un búfer LVDS entre una función Altera_PLL y ALTLVDS_RX o mega ALTLVDS_TX cuando se utiliza en modo PLL externo para dispositivos Cyclone® V, Arria® V y Stratix® V cuando se activa cualquiera de las siguientes opciones:

  • Habilitar la reconfiguración dinámica de PLL
  • Habilite el acceso a puertos de cambio de fase dinámico
  • Habilitar parámetros de reloj de salida física

Resolución

Descargue este documento instructivo para aprender cómo puede agregar un búfer LVDS intermedio entre la PI externa de PLL y ALTLVDS.

El documento How-To hace referencia a diseños de ejemplo que puede descargar en VHDL o Verilog para cada uno de los dispositivos Cyclone® V, Arria® V y Stratix® V:

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