Debido a un problema en la versión 15.0 de Quartus® II, un fPLL de Intel® Arria® 10 puede generar frecuencias de reloj incorrectas o relojes desalineados en estas circunstancias:
Caso 1: La frecuencia de reloj de salida puede ser incorrecta después de la reconfiguración dinámica entre los modos de entero y fracción.
Caso 2: Si el fPLL en el modo de núcleo tiene varias salidas, es posible que los relojes de salida no estén en fase.
Este problema se corrigió en Intel® Quartus® Versión 15.1.2 y posteriores del software Prime.