ID del artículo: 000080746 Tipo de contenido: Resolución de problemas Última revisión: 22/04/2022

¿Puede la interfaz esclavo Avalon-MM Txs de 128 bits de la pi de disco duro Altera para la solicitud de lectura/escritura de controlador PCI Express con ByteEnable=0x01?

Entorno

  • Software de diseño Intel® Quartus® Prime
  • PCI Express*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido a un problema en la versión 13.1 del software Quartus® II y versiones anteriores, la interfaz esclavo Avalon-MM® Txs de 128 bits de hard IP para PCI Express* no puede generar un paquete de TLP PCI Express correcto cuando el paquete ByteEnable = 0x01, 0x03 o 0x7 en la interfaz Avalon-MM.

    los puentes Avalon-MM funcionan correctamente con una cantidad de ráfagas = 1 y se activa el siguiente byte (activar bytes DW)

    16'hF000
    16'h0F00
    16'h00F0
    16'h000F
    16'hFF00
    16'h0FF0
    16'h00FF
    16'hFFF0
    16'h0FFF
    16'hFFFF

    Resolución

    Para solucionar este problema, utilice una interfaz esclavo Avalon-MM Txs de 64 bits o establezca ByteEnable en más de 0x07 (active 4 bytes o más) con una interfaz esclavo Avalon-MM Txs de 128 bits.

    Actualmente no hay ningún plan para solucionar este problema.

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