Sí, debido a un problema en las versiones de software Intel® Quartus® Prime Pro Edition 17.1 y anteriores, las E/S de 3V en Intel® Stratix® 10 FPGAs podrían generar un alto durante la configuración cuando se les asigna a los pines como salidas en su diseño compilado.
Este comportamiento no se ve cuando se asigna a las E/S 3V como entradas o E/S bidireccionales.
Estas E/S 3V se encuentran en bancos de E/S 6A,6B,6C,7A,7B,7C, y están disponibles en diferentes variantes de densidad y paquete de Intel Stratix 10 dispositivos.
Este problema está programado para solucionarse en un futuro lanzamiento del software Intel Quartus Prime Pro Edition.