ID del artículo: 000076487 Tipo de contenido: Resolución de problemas Última revisión: 18/08/2023

¿Por qué hay una discrepancia en el resultado de salida de FFT Intel® FPGA IP en la simulación entre el modelo MATLAB* generado por IP y el modelo HDL?

Entorno

    Intel® Quartus® Prime Pro Edition
    Intel® Quartus® Prime Standard Edition
    FFT FPGA IP Intel®
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descripción

Debido a un problema con FFT Intel® FPGA IP versión 19.1, puede observar el problema anterior en la simulación si el ancho de salida de datos de la IP no está configurado para el ancho máximo admitido.

Resolución

Para evitar este problema, configure el ancho de salida de datos en el ancho máximo admitido en IP.

Este problema no está programado actualmente para ser corregido en una versión futura de la Intel® FPGA IP FFT.

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