ID del artículo: 000076360 Tipo de contenido: Resolución de problemas Última revisión: 11/01/2023

¿Cuál es el tamaño máximo de carga útil que puedo emitir el HARD IP PCI Express en la interfaz Avalon-ST TX?

Entorno

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    Hard IP Stratix® V para PCI Express* con SR-IOV FPGA IP Intel®
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descripción

En el modo Avalon-ST, se requiere la lógica del usuario para asegurarse de que el TX TLP presentado al núcleo IP PCI* Express no sea mayor que el tamaño de carga máxima de acceso.

 

 

Resolución

Asegúrese de que la TX TLP presentada al núcleo DE IP PCI* Express no sea mayor que el tamaño de carga máxima expresada.

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