Debido a la restricción de Intel® FPGA IP de Ethernet de triple velocidad con la opción "LVDS" como "tipo de transceptor", no se pueden combinar los IOPLLs.
Es posible que vea este error en el software Intel® Quartus® Prime cuando inicia varios Intel® FPGA IP Ethernet de triple velocidad con la opción "LVDS" como "tipo de transceptor" en un solo banco de E/S para el Intel® Arria® 10, Intel® Cyclone® 10 GX o Intel® Stratix® dispositivo 10 L-Tile/H-Tile.
Para evitar este error, siga los pasos a continuación:
- Genere los Intel® FPGA IP Ethernet de triple velocidad con la opción "Ninguno" como "tipo de transceptor".
- Genere los Intel® FPGA IP LVDS SERDES con varios canales.
- Conecte dos IPs manualmente.