En la calculadora de reconfiguración de ciclo bloqueado por fase (PLL) para dispositivos Stratix® V, Arria® V o Cyclone® V, la configuración del ancho de banda fraccional de PLL se fija en "bajo". No es posible modificar la configuración de ancho de banda en la calculadora porque la especificación de inestabilidad en la hoja de datos solo cubre los PLLs fraccionales con un ancho de banda bajo.
Si necesita volver a configurar la configuración de ancho de banda fraccional de PLL a "alta", invoque el editor de parámetros Intel FPGA IP PLL e ingrese la configuración de ancho de banda junto con la configuración del contador requerido. Genere un archivo MIF y busque la configuración de bits en este archivo MIF.