ID del artículo: 000074947 Tipo de contenido: Resolución de problemas Última revisión: 17/03/2023

¿Es posible habilitar o deshabilitar dinámicamente redes de reloj global (GCLK) o de reloj regional (RCLK) que fomenten fPLLs en dispositivos Stratix® V, Arria® V o Cyclone® V?

Entorno

  • Edición de suscripción de Intel® Quartus® II
  • PLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    No, no es posible habilitar ni deshabilitar dinámicamente redes de reloj global (GCLK) o de reloj regional (RCLK) que fomenten fPLLs en dispositivos Stratix® V, Arria® V o Cyclone® V.

    Sin embargo, debido a un problema en el software Quartus® II versión 13.1 y anteriores, si utiliza la señal de habilitación en un bloque de control de reloj que impulsa un fPLL, la compilación no fallará.

     

    Resolución

    Las versiones futuras del software Quartus II están programadas para generar un mensaje de error/advertencia cuando se utiliza la señal de habilitación en un bloque de control de reloj que impulsa un fPLL,

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