Integridad de la señal e integridad de la potencia – Centro de soporte
¡Bienvenido al Centro de Soporte de Integridad de Señal e Integridad de Potencia!
Aquí encontrará información sobre cómo garantizar la integridad de la señal y la integridad de la potencia en sus diseños de alta velocidad.
¡Disfruta de tu viaje!
Obtenga recursos de asistencia para dispositivos Intel Stratix® 10, Intel Arria® 10 e Intel Cyclone® 10 en las páginas siguientes. Para otros dispositivos, busque desde los siguientes enlaces: Archivo de documentación, Cursos de capacitación, Videos y webcasts, Ejemplos de diseñoy Base de conocimientos.
Directrices y documentación
Diseño de la Junta - Directrices generales
- Base de datos de conocimientos (KDB) de Intel® para todas las FPGA ›
- Asesor de diseño de juntas de alta velocidad ›
- Centro de recursos de diseño de placas ›
- Informe técnico sobre la guía de velocidad de borde de señal de entrada ›
- Lista de comprobación de la red de distribución de energía (PDN) ›
- AN 574: Metodología de diseño de la red de suministro de energía (PDN) de la placa de circuito impreso (PCB) ›
- AN 613: Consideraciones de diseño de APIlamiento de PCB para FPGA Intel® ›
Diseño de placa - Directrices sobre interfaces de memoria externa
Diseño de placa - Directrices de transceptores
- UG-20298: Directrices de diseño de integridad de señal de la familia de dispositivos Intel® Agilex™ de alta velocidad ›
- AN 528: Selección de material dieléctrico de PCB y efecto de tejido de fibra en el enrutamiento de canales de alta velocidad ›
- AN 529: A través de técnicas de optimización para diseños de canales de alta velocidad ›
- AN 530: Optimización de la discontinuidad de impedancia causada por las almohadillas de montaje en superficie para diseños de canales de alta velocidad ›
- AN 596: Consideraciones de modelado y diseño para conectores de 10 Gbps ›
- AN 651: Enrutamiento de ruptura de PCB para diseños de canales serie de alta densidad más allá de 10 Gbps ›
- AN 672: Directrices de diseño de enlaces de transceptor para la transmisión de alta velocidad de datos gbps ›
- AN 678: Sintonización de enlaces de alta velocidad mediante circuitos de acondicionamiento de señal en transceptores Stratix® V ›
- AN 684: Directrices de diseño para 100 Gbps - Interfaz CFP2 ›
- AN 689: Diseño de canales de alta velocidad con el protocolo SFF-8431 ›
- AN 766: Dispositivos Stratix 10, Guía de diseño de diseño de interfaz de señal de alta velocidad ›
- Modelado de la rugosidad de la superficie de cobre para diseños de canales multi-Gigabit ›
Cursos de formación y vídeos
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Utilice el modelo IBIS-AMI para estimar la integridad de la señal del transceptor Intel Arria 10 |
Aprenda a realizar una simulación de integridad de señal con un transceptor Intel Arria 10 modelo IBIS-AMI en el analizador de enlaces avanzado. Además, este video cubre los informes de diagramas oculares. |
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