ID del artículo: 000094227 Tipo de contenido: Resolución de problemas Última revisión: 04/06/2025

Advertencia crítica (332049): Ignorado create_generated_clock en altera_emr_unloader.sdc(14): El argumento <targets> es una colección vacía</targets>

Entorno

    Intel® Quartus® Prime Standard Edition
    Mensaje de error Registro Descargador FPGA IP Intel®
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descripción

Debido a un problema en la versión 22.1 del software Quartus® Prime Standard Edition, es posible que vea esta advertencia crítica cuando utilice la IP del descargador del registro de mensajes de error.

También verá un reloj sin restricciones reportado en el Informe de rutas no restringidas en el Analizador de tiempo, como se muestra a continuación, cuando utilice la IP del descargador del registro de mensajes de error. Esto se debe a la restricción en altera_emr_unloader.sdc, que no pudo resolver este problema.

*|altera_emr_unloader:emr_unloader_component|current_state. STATE_CLOCKHIGH

Resolución

Para evitar este problema en la versión 22.1 del software Quartus® Prime Standard Edition, siga estos pasos:

  1. En el archivo altera_emr_unloader.sdc , comente la línea 14.
  2. Agregue la restricción create_generated_clock al archivo altera_emr_unloader.sdc . Por ejemplo:

create_generated_clock -name emr_unloader_STATE_CLOCKHIGH -source [get_pins {*|alt_fault_injection_component|alt_fi_inst|*oscilador|clkout}] [get_keepers { *|emr_unloader_component|current_state. STATE_CLOCKHIGH}]

Este problema está programado para ser solucionado en una versión futura del software Quartus® Prime Standard Edition.

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Este artículo se aplica a 3 productos

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