ID del artículo: 000091129 Tipo de contenido: Resolución de problemas Última revisión: 09/08/2023

¿Por qué el Intel® Stratix® 10 L- and H-Tile Transceiver Toolkit se bloquea cuando se ejecuta un barrido automático de PMA largo cuando el modo de adaptación RX CTLE, VGA y DFE está configurado en Automático?

Entorno

  • Intel® Quartus® Prime Pro Edition
  • Transceptor L-Tile H-Tile PHY Nativo Intel® Stratix® 10 FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido al bus de interfaz de memoria mapeado de memoria (AVMM) PHY nativo de 10 L- y H-Tile Avalon Intel® Stratix® compartido, el kit de herramientas del transceptor puede bloquearse con las ejecuciones largas de PMA Autosweep cuando el modo de adaptación RX está configurado en "Adaptive CTLE, Adaptive VGA, All-Tap Adaptive DFE".

    El bus AVMM PHY IP nativo L y H-Tile se comparte entre varios maestros que incluyen: lógica de usuario, NPDME (kit de herramientas de transceptor), PreSICE, transmisor, registros de configuración, capacidad de reconfiguración y control.

    El NPDME (kit de herramientas del transceptor) y el motor adaptativo RX requieren acceso a la interfaz AVMM. Las ejecuciones de barrido automático prolongadas aumentan la posibilidad de un conflicto de acceso AVMM y el posterior bloqueo del kit de herramientas del transceptor.

    Resolución

    Para evitar este problema, puede reducir las ejecuciones de Autosweep o seleccionar modos estáticos para el RX PMA, como "CTLE manual, VGA manual, DFE desactivado" o "CTLE adaptativo, VGA adaptativo, DFE desactivado".

    Productos relacionados

    Este artículo se aplica a 1 productos

    FPGA de SoC y FPGA Intel® Stratix® 10

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