ID del artículo: 000088419 Tipo de contenido: Resolución de problemas Última revisión: 06/06/2023

¿Cómo puedo ver los límites de la región del reloj de fila en el Intel® Quartus® software Prime Pro Edition?

Entorno

    Intel® Quartus® Prime Pro Edition
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Descripción

La guía del usuario de Intel® Quartus® Prime Pro Edition: La reconfiguración parcial dice: "No puede compartir un reloj de fila entre dos regiones de PR", pero no especifica claramente cómo ver los límites de la región del reloj de fila en Intel® Quartus® versión del software Prime Pro Edition.

Resolución

Para Intel® Arria® 10 dispositivos y dispositivos Intel® Cyclone® 10 GX, siga estos pasos:

  1. Haga clic Herramientas > desglose de chips.
  2. En ChipTata, haga clic en la pestaña Capas y seleccione la capa Básica.
  3. Verificar la región del reloj espinal; verá los límites de la región del reloj espinal.
  4. Una región del reloj de fila es un reloj ancho de media columna (dividido por la línea de contorno) y una fila LAB alta.

Para Intel® Stratix® 10 dispositivos y dispositivos Intel Agilex®, siga estos pasos:

  1. Haga clic en Herramientas > desglose de chips.
  2. En ChipTata, haga clic en la pestaña Capas y seleccione la capa Básica.
  3. Comprobar Región del sector de reloj; verá los límites de la región del sector del reloj.
  4. Una región de reloj de fila es de ancho del sector de medio reloj (dividido por la línea de contorno) y una fila LAB alta.

Productos relacionados

Este artículo se aplica a 4 productos

FPGAs y FPGAs de sistema integrado en chip Intel® Agilex™ 7
FPGA de SoC y FPGA Intel® Arria® 10
FPGA Intel® Cyclone® 10 GX
FPGA de SoC y FPGA Intel® Stratix® 10

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