Debido a un problema en la versión 17.0 o anterior del software Quartus® Prime Pro Edition, la etapa de síntesis se bloquearía al inferir una RAM de ancho mixto con un puerto de 1 bit de ancho en un diseño.
Para evitar este problema, cree instancias de la RAM desde el catálogo IP con la misma configuración de parámetros en lugar de utilizar la codificación RTL para inferir la RAM.
Este problema se solucionó a partir de la versión 17.1 del software Quartus® Prime Pro Edition.