ID del artículo: 000080951 Tipo de contenido: Mensajes de error Última revisión: 29/12/2022

Error interno: sistema secundario: FYGR, archivo: /quartus/fitter/fygr/fygr_cdr_op.cpp, línea: 2875

Entorno

  • Intel® Quartus® Prime Standard Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido a un problema en el software Intel® Quartus® Prime Standard Edition versión 19.1 o anterior, es posible que vea este error interno cuando se asigna el estándar de E/S a LVDS, pero este pin no está conectado a la PI LVDS. Este problema solo se produce en los dispositivos Max® V.

    Resolución

    Para solucionar el problema, cambie el estándar de E/S de LVDS a otro tipo de estándar de E/S si el pin no está conectado a la PI LVDS .

    Productos relacionados

    Este artículo se aplica a 1 productos

    CPLD MAX® V

    El contenido de esta página es una combinación de la traducción humana y automática del contenido original en inglés. Este contenido se ofrece únicamente para su comodidad como información general y no debe considerarse completa o precisa. Si hay alguna contradicción entre la versión en inglés de esta página y la traducción, prevalecerá la versión en inglés. Consulte la versión en inglés de esta página.