ID del artículo: 000074421 Tipo de contenido: Resolución de problemas Última revisión: 14/02/2023

¿Por qué no puedo programar el dispositivo de configuración EPCQ-L con un archivo .jic en un kit de desarrollo de Intel® Arria® 10 SoC?

Entorno

  • Intel® Quartus® Prime Pro Edition
  • Programador independiente Intel® 10.23 (para el software Legacy Max+Plus® II)
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Es posible que vea el siguiente mensaje de error en el programador de software Intel® Quartus® Prime al programar el dispositivo de configuración EPCQ-L con un archivo .jic en una revisión B Intel® Arria® kit de desarrollo de 10 SoC.

    Error (209012): Error en la operación. CONF_DONE no pudo subir

    De forma predeterminada, la cadena JTAG del kit de desarrollo consta de una Intel Arria 10 FPGA, su HPS y un dispositivo MAX® V (I/O MUX CPLD). Además, la frecuencia TCK de la placa Intel® FPGA Download Cable II predeterminada a 24 MHz

    Dado que el período mínimo de JTAG TCK para MAX dispositivos V es de 100 ns, es el dispositivo más lento de la cadena JTAG y contribuye al fallo de configuración.

     

    Resolución

    Para programar el dispositivo EPCQ-L en el kit de desarrollo de Intel Arria 10 SoC correctamente con un archivo .jic, siga estos dos pasos:

    • Mientras se programa con la configuración predeterminada de la placa, (Intel Arria 10 y MAX dispositivos V habilitados en la cadena JTAG) reducen el reloj JTAG a 6 MHz con el comando: "jtagconfig --setparam JtagClock 6M"
    • Retire el MAX V CPLD de la cadena estableciendo el 3er bit de DIP SW3 en la posición OFF.

    Productos relacionados

    Este artículo se aplica a 2 productos

    FPGA de SoC y FPGA Intel® Arria® 10
    CPLD MAX® V

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