Función de la PI de la controladora QDR II SRAM de FPGA Intel®

La PI de la controladora QDR II SRAM de FPGA Intel® ofrece una interfaz fácil de usar para los módulos QDR II SRAM y QDR II+ SRAM. La controladora QDR II SRAM garantiza que la ubicación y la sincronización coincidan con las especificaciones de QDR II. La interfaz local de la controladora QDR II SRAM es compatible con la interfaz de mapeo de memoria de FPGA Intel® Avalon®, para una fácil integración con la PI de Intel® Qsys.

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Función de la PI de la controladora QDR II SRAM de FPGA Intel®

La PI de la controladora QDR II SRAM de FPGA Intel® está optimizada para las FPGAs serie Stratix® y Cyclone® IV. Las características avanzadas disponibles de estos dispositivos le permiten conectarse directamente con los dispositivos QDR II SRAM.

El diseño de ejemplo generado por el banco de herramientas de la PI instancia un bucle de bloqueo de fase (PLL), un bucle de bloqueo de retardo opcional (solo para las FPGAs Stratix II), un controlador de ejemplo y su variación personalizada de la controladora QDR II SRAM. El diseño de ejemplo es totalmente funcional y puede ser simulado, sintetizado y utilizado en el hardware. El controlador de ejemplo es un módulo de autoprueba que emite comandos de lectura y escritura para el controlador y verifica los datos de lectura para producir las señales de superada/no superada y de prueba completa. Puede reemplazar la lógica de control cifrada de la controladora QDR II SRAM del diseño de ejemplo por su propia lógica personalizada, que le permite utilizar la resincronización de texto claro de FPGA Intel®, la lógica de canalización y la ruta de datos con su propia lógica de control.

Esta PI está incluida en el conjunto básico de PI, IP Base Suite, que abarca el software Intel® Quartus® Prime Standard y Pro Edition.

Funciones

  • Asistencia para SRAMs QDR II y QDR II+
  • Asistencia para ráfagas de memoria tipo dos y cuatro
  • Asistencia para interfaces QDR II SRAM de 8 bits, 18 bits y 36 bits
  • Diseño flexible y sólido
  • Asistencia para ancho de datos de dos y cuatro veces en el lado local (cuatro veces solo para ráfagas de cuatro)
  • Concatenación automática de lecturas y escrituras consecutivas (solo modo de ancho de bus local estrecho)
  • Modelos de simulación funcional de propiedad intelectual (PI) para utilizar en simuladores VHDL y HDL Verilog compatibles con Intel
  • Interfaz de banco de herramientas de PI fácil de usar y diseño de ejemplo
  • Asistencia para el modo de evaluación de PI FPGA Intel®

Recursos adicionales

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