Serial Lite IV Intel® FPGA IP Core

El núcleo de propiedad intelectual (PI) de Serial Lite IV Intel FPGA es adecuado para la comunicación de datos de gran ancho de banda para aplicaciones chip a chip, placa a placa y backplane.

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Serial Lite IV Intel® FPGA IP Core

El núcleo Serial Lite IV PI incorpora un control de acceso a medios (MAC), una subcapa de codificación física (PCS) y un bloque de fijación de medios físicos (PMA). La IP es compatible con transferencias de datos de hasta 58 Gbps por carril con un máximo de 12 carriles PAM4 de los transceptores de uso general en F-tile (FGT) de Intel Agilex™ 7 y hasta 116 Gbps, con un máximo de 4 carriles PAM4 de los transceptores de alta velocidad en F-tile (FHT) de Intel Agilex™ 7 en un solo vínculo; o 28 Gbps por carril con un máximo de 16 carriles de no retorno a cero (NRZ) de FGT y 58 Gbps por carril con un máximo de 4 carriles de NRZ de FHT. Este protocolo ofrece un gran ancho de banda, pocas tramas de sobrecarga y un bajo recuento de E/S, y es compatible con una gran escalabilidad tanto en la cantidad de carriles como en la velocidad. La IP se puede volver a configurar fácilmente y es compatible con una amplia gama de velocidades de datos con el modo Ethernet PCS del transceptor E-Tile y del transceptor F-Tile con nuestros transceptores GTS más recientes para dispositivos Agilex™ 5.

Esta IP es compatible con dos modos de transmisión:

  • Modo básico: se trata de un modo de transmisión puro en el que los datos se envían sin el inicio del paquete, el ciclo vacío y el final del paquete para aumentar el ancho de banda. La PI toma el primer dato válido como inicio de una ráfaga.
  • Modo completo: Este es el modo de paquete de transferencia de datos. Se envía una ráfaga y un ciclo de sincronización al principio y al final de un paquete como delimitadores.

Funciones

Característica Descripción
Transferencia de datos
  • Es compatible con hasta 116 Gbps por carril con un máximo de 4 carriles PAM4 de FHT en un solo enlace.
  • Es compatible con hasta 58 Gbps por carril con un máximo de 4 carriles NRZ de FHT en un solo enlace.
  • Es compatible con hasta 58 Gbps por carril con un máximo de 12 carriles PAM4 de FGT en un solo enlace.
  • Es compatible con hasta 28 Gbps por carril con un máximo de 16 carriles NRZ de FGT en un solo enlace.
  • Compatible con modos de transmisión continua (básico) o paquetes (completo).
  • Compatible con paquetes de fotogramas de bajo sobrecarga.
  • Compatible con transferencia de granularidad de bytes para cada tamaño de ráfaga.
  • Compatible con alineación de carriles automática o iniciado por el usuario.
  • Compatible con un período de alineación programable.
PC
  • Utiliza lógica de IP física que se interconecta sin problemas con los transceptores E-Tile de los dispositivos Intel® Stratix® 10 e Intel Agilex™ 7 para la reducción de recursos de lógica blanda.
  • Compatible con el modo de modulación PAM4 para la especificación 100GBASE-KP4. RS-FEC siempre está habilitado en este modo de modulación.
  • Compatible con el modo de modulación NRZ con detección y corrección de errores KR-FEC (opcional).
  • Compatible con la decodificación de codificación 64b/66b.
Detección y manejo de errores
  • Compatible con la comprobación de errores de comprobación de redundancia cíclica (CRC) en las rutas de datos de transmisión (TX) y recepción (RX).
  • Compatible con la comprobación de errores de enlace de RX.
  • Compatible con la detección de errores de RX PCS.
Interfaces
  • Compatible solo con la transferencia de paquetes de dúplex completos con enlaces independientes.
  • Utiliza la interconexión punto a punto con varios FPGA con baja latencia de transferencia.
  • Compatible con los comandos definidos por el usuario.
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Estado de IP

Vigilancia Códigos de pedido Estado de pedido
Serial Lite IV Intel® FPGA IP IP-SLITE4 Producción
Serial Lite IV Intel FPGA IP para F-Tile IP-SLITE4F Producción

Serial Lite IV Intel FPGA IP para GTS

IP-SLITE4F

 Preliminares
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Recursos adicionales

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