RapidIO Intel® FPGA IP
Intel está descontinuando la propiedad intelectual (IP) para RapidIO I y RapidIO II, puede encontrar más información en la notificación de descontinuación del producto (PDN2025).
RapidIO Intel® FPGA IP
Intel ofrece dos IP de Intel® FPGA distintas para RapidIO:
- RapidIO Intel® FPGA IP cumple con la revisión de especificaciones de RapidIO 2.2
- Separación de las capas física, de transporte y lógica (arquitectura modular)
- Secuencia IDLE2: símbolo de control largo
- Velocidades de carril de 1.25, 2.5, 3.125, 5.0 y 6.25 Gbaud con anchos de enlace de 1X, 2X y 4X
- RapidIO Intel® FPGA IP cumple con las revisiones de especificaciones de RapidIO 1.3/2.1
- Separación de las capas física, de transporte y lógica (arquitectura modular)
- Secuencia IDLE1: símbolo de control corto
- Velocidades de carril de 1.25, 2.5, 3.125 y 5.0 Gbaudios con anchos de enlace 1X y 4X
Para conocer los detalles de compatibilidad del dispositivo, como las tasas de carril, los anchos de enlace y los grados de velocidad, consulte las guías del usuario de PI de RapidIO Intel FPGA.
Funciones
Una parte importante de la industria inalámbrica adopta el estándar RapidIO como interconexión de alta velocidad. El estándar RapidIO se utiliza normalmente entre los procesadores de señales digitales, así como entre los procesadores del plano de control y la memoria. RapidIO también está ganando aceptación como interconexión de backplane debido a su adopción de estándares ampliamente utilizados para las características eléctricas del accesorio de medios físicos (PMA), como XAUI o CEI para una velocidad de datos de hasta 6,25 Gbaudios. Las FPGA Intel® también son capaces de soportar velocidades de datos RapidIO Gen3.
- PHY basado en transceptores integrados
- Facilidad de uso
- El editor de parámetros de propiedad intelectual (IP) permite una fácil optimización manual de los parámetros, como las profundidades FIFO de la interfaz, las ventanas de traducción de direcciones, la tensión diferencial de salida y la preacentuación
- La fácil configuración ofrece formas de reducir la utilización de recursos para crear variaciones de funciones de IP de FPGA Intel® más pequeñas según las necesidades de la aplicación
- Diseñador de plataformas para la interconexión de sistemas
- Solución robusta
- Núcleo de IP de punto final, bancos de pruebas con interoperabilidad comprobada con los principales proveedores de procesadores de señales digitales y conmutadores
- Cumple la especificación de RapidIO, Revisión 1.3/2.1 y 2.2
Para una solución lista para la integración a nivel de sistema, puede ahorrar varios meses de tiempo de diseño seleccionando todas las capas de RapidIO, incluidas las funciones como la traducción de direcciones y las sencillas interfaces FIFO Avalon Memory-Mapped (Avalon-MM) y Avalon Streaming (Avalon-ST).
Solución de protocolo
Una de las imágenes muestra un ejemplo de un sistema construido utilizando el Platform Designer con un procesador embebido suave Nios® II como elemento de procesamiento. La memoria de programa puede incluir el "código de arranque" para la enumeración a nivel de sistema de los distintos puntos finales. El programa también configura los registros de direcciones de capacidad de los puntos finales y la función de PI de Intel FPGA.
Parámetros de calidad de PI
Aspectos básicos |
|
---|---|
El año en que se lanzó por primera la PI |
2009 |
Versión más reciente compatible con el software Intel® Quartus Prime |
18.1 |
Estado |
Producción |
Entregas |
|
Las entregas para el cliente son las siguientes: Archivo de diseño (código fuente cifrado o lista de conexiones post-síntesis) Modelo de simulación para ModelSim*-Intel® FPGA Edition Limitaciones de tiempo o diseño Banco de pruebas o ejemplo de diseño Documentación con control de revisión Archivo Léame |
Sí Sí Sí Sí Sí No |
Cualquier producto adicional Para los clientes provistos con IP |
Ninguna |
GUI de parametrización que permite al usuario final configurar IP |
Sí |
Se habilitó el núcleo de PI que facilita la asistencia para el modo de evaluación de la PI de FPGA Intel® |
Sí |
Idioma de origen |
Verilog y VHDL |
Idioma de herramienta de prueba |
Verilog y VHDL |
Se proporcionan los controladores del software |
No |
Compatibilidad con el sistema operativo (SO) de controladores |
N/C |
Implementación |
|
Interfaz de usuario |
Avalon-MM, Avalon-ST |
metadatos IP-XACT |
No |
Verificación |
|
Compatible con simuladores |
ModelSim*, VCS, Riviera-PRO, NCSim |
Hardware validado |
Intel Arria 10, Arria V, Intel Cyclone 10 GX, Cyclone V, Intel Stratix 10, Stratix V |
Se realizaron pruebas de cumplimiento estándares en el sector |
No |
De ser así, ¿cuáles? |
N/C |
De ser así, ¿en cuál de los dispositivos FPGA Intel®? |
N/C |
De ser así, fecha de cuándo se realizó |
N/C |
De no ser así, ¿se planificó? |
No |
Interoperabilidad |
|
Se realizaron pruebas de interoperabilidad en la PI |
Sí |
De ser así, ¿en qué dispositivos FPGA Intel®? |
Arria V, Intel Arria 10, Intel Cyclone 10 GX, Intel Stratix 10 |
Hay informes de interoperabilidad disponibles |
Sí |
Enlaces relacionados
Asistencia para dispositivos
Recursos adicionales
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