Altera® FPGA IP JESD204C
JESD204C Altera® FPGA IP es una interfaz serial de alta velocidad de punto a punto para convertidores digitales a analógico (DAC) o analógicos a digital (ADC) para transferir datos a dispositivos FPGA.
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Guía del usuario de Agilex™ 7 F-Tile FPGA IP JESD204C ›
Guía del usuario de Altera® FPGA IP JESD204C para GTS›
Altera® FPGA IP JESD204C
Altera® FPGA IP JESD204C incluye:
- Control de acceso al medio (MAC): bloques de capas de enlace de datos (DLL) y de capas de transporte que controlan los estados de enlaces.
- Capa física (PHY): subcapa de codificación física (PCS) y bloque de accesorio medio físico (PMA).
Funciones
El núcleo de Altera® FPGA IP JESD204C ofrece las siguientes características clave:
- Una velocidad de datos de hasta 32,44032 Gbps para dispositivos Agilex™ 7 F-tile, de 28,9 Gbps para dispositivos Agilex™ 7 E-tile y Stratix® 10 E-tile, y de 17,16 Gbps para dispositivos Agilex™ 5 serie E.
- Carriles individuales o varios (hasta 16 carriles por enlace)
- Contador de reloj multibloque local extendido (LEMC) basado en E=1 a 256
- Alineación y monitoreo de carriles seriales
- Sincronización de carriles
- Diseño modular que es compatible con sincronización de varios dispositivos
- Partición MAC y PHY
- Compatibilidad de latencia determinista
- codificación 64/66
- Codificación/decodificación
- Interfaz de transmisión Avalon® para transmitir y recibir rutas de datos
- Interfaz de mapeado de memoria Avalon® para registros de control/estado (CSR)
- Generación dinámica del banco de pruebas de simulación
- Modo TX PMA vinculado y no vinculado
- Compatibilidad opcional con ECC M20K DCFIFO
- Opciones para configuraciones de encabezados de sincronización
- CRC-12
- Canales de comando independientes
Estado de IP
Estado de pedido |
Producción |
Códigos de pedido |
|
PAQUETE de Altera® FPGA IP JESD204 |
IPS-JESD204 (contiene JESD204B, JESD204B-FTILE, JESD204C, JESD204C-FTILE) |
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