IP FPGA Intel® 10GBASE-R PHY
El núcleo de propiedad intelectual (PI) FPGA Intel® 10GBASE-R PHY permite tener conectividad de forma directa con cualquier módulo óptico XFP o SFP+ o con cualquier dispositivo externo con interfaces XFI y SFI.
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Guía de usuario de PHY del transceptor Intel® Arria® 10 ›
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Guía de usuario del núcleo PI de PHY del transceptor de serie V ›
Guía de usuario de la función 10-Gbps Ethernet MAC MegaCore ›
IP FPGA Intel® 10GBASE-R PHY
El núcleo PI PHY se puede utilizar tanto con PI FPGA Intel® para 10 G Ethernet MAC o con Ethernet MAC desarrollado por el cliente a través de una interfaz XGMII estándar que funciona a 156,25 Mbps.
Este núcleo PI PHY está disponible como parte de la funcionalidad del transceptor de FPGA Intel®.
Funciones
- El PHY consiste en la subcapa de codificación física (PCS) 10GBASE-R, el accesorio de medio físico (PMA) de 10,3125-Gbps y las funciones de gestión de PHY.
- Interfaz directa con MAC de 10 GbE para una solución completa de un solo chip.
- PHY integrado en el silicio reforzado de las FPGA Intel® Arria® 10, Stratix® V y Arria® V GZ con transceptores seriales de 10,3125 Gbps. Las PCS 10GBASE-R Soft también están disponibles en FPGA Stratix® IV GT y Arria® V (GT y ST).
- Conexión serie directa de 10,3125 Gbps de chip a chip, de chip a módulo óptico, de chip a dispositivo PHY y aplicaciones de backplane.
- Soporte de E/S dinámica reconfigurable parcial (DPRIO) en transceptores seriales para adaptarse a varias características y dispositivos del canal 10GBASE-R en los sistemas durante el funcionamiento.
- Implementación de las funciones de PHY 10GBASE-R de estándar Ethernet: codificación o decodificación de 64b/66b, cifrado/descifrado, adaptación de la velocidad del receptor para la compensación de frecuencia de reloj, gear-boxing 66b/16b, y serialización o deserialización de datos hacia y desde la línea de 10,3125 Gbps.
- Detección de estado de falla del enlace de recepción.
- Bucle de retorno serial local desde el transceptor al receptor en el transceptor serial para pruebas.
- Opción IEEE 1588 v2 para un registro de tiempo de alta precisión y exactitud.
- Interfaces de sistema interno de alto desempeño
- Transmisión con Intel® FPGA Avalon® XGMII de tasa de datos sencilla (SDR) (Avalon-ST), 72 bits a 156,25 Mbps para transferencia de datos
- Mapeo de memoria Intel® FPGA Avalon® (Avalon-MM) 32 bits para administración de esclavos
- En conformidad con el estándar IEEE 802.3 10GbE, cláusulas 46, 49 y 51.
- Con pruebas de validación de 10 Gbps Ethernet MAC y PCS del laboratorio de interoperabilidad la Universidad de New Hampshire (UNH-IOL) superadas.
Parámetros de calidad de PI
Aspectos básicos |
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El año en que se lanzó por primera la PI |
2015 |
Compatible con la primera versión del software Intel® Quartus® Prime |
16.1 |
Códigos de pedido |
PI-10GMRPHY: Intel Arria 10 PI-10GBASERPCS: serie Cyclone V PI-10GMRPHY: Intel Cyclone10 PI-10GETHMAC: MAC MegaCore Ethernet de 10 Gbps |
Estado |
Producción |
Entregas |
|
Las entregas para el cliente son las siguientes: Archivo de diseño (código fuente cifrado o lista de conexiones post-síntesis) Modelo de simulación para ModelSim*: Intel FPGA Edition Limitaciones de tiempo o diseño Documentación con control de revisión Archivo Léame |
Y |
Cualquier producto adicional Para los clientes provistos con IP |
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GUI de parametrización que permite al usuario final configurar IP |
Y |
Se habilitó el núcleo de PI que facilita la asistencia para el modo de evaluación de la PI de FPGA Intel® |
Y |
Idioma de origen |
Verilog |
Idioma de herramienta de prueba |
|
Se proporcionan los controladores del software |
N |
Asistencia de SO para controladores |
|
Implementación |
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Interfaz de usuario |
Tasa de datos única XGMII / GMII / GMII de 16 bits (ruta de datos), Avalon®-MM (gestión) |
metadatos IP-XACT |
N |
Verificación |
|
Compatible con simuladores |
Mentor Graphics*, Synopsys*, Cadence* |
Hardware validado |
Intel Stratix 10, Intel Arria 10 |
Se realizaron pruebas de cumplimiento estándares en el sector |
Y |
De ser así, ¿cuáles? |
46, 49 y 51 |
De ser así, ¿en cuál de los dispositivos FPGA Intel®? |
|
De ser así, fecha de cuándo se realizó |
|
De no ser así, ¿se planificó? |
N |
Interoperabilidad |
|
Se realizaron pruebas de interoperabilidad en la PI |
N |
De ser así, ¿en qué dispositivos FPGA Intel®? |
|
Hay informes de interoperabilidad disponibles |
N |
Enlaces relacionados
Documentación
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- Guía de usuario de la función 10-Gbps Ethernet MAC MegaCore
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Recursos adicionales
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