Warp FPGA IP Intel®
Warp Intel® FPGA IP es un núcleo de PI altamente optimizado para aplicar correcciones geométricas y distorsiones arbitrarias no lineales en una transmisión de video en tiempo real.
Notas sobre el producto Warp Intel® FPGA IP ›
Guía del usuario de la suite de procesamiento de video y visión Intel® FPGA IP ›
Especificación del protocolo de transmisión de video para FPGA Intel® ›
Warp FPGA IP Intel®
Descripción general
Warp Intel® FPGA IP es un núcleo altamente optimizado para aplicar correcciones geométricas y distorsiones arbitrarias no lineales en una transmisión de video en tiempo real de hasta 3840 × 2160 píxeles y hasta 60 fotogramas por segundo. Se logra la calidad máxima de imagen gracias al filtrado por pixel con la interpolación bicubic en los datos de video 4:4:4 con resolución de color completa en hasta 10 bits por plano de color. Warp Intel® FPGA IP viene con un conjunto de componentes de software, incluidos un controlador de software que permite configurar y controlar todos los parámetros necesarios de la PI, un generador de datos de deformación y un generador de malla de deformación de ejemplo. Se puede implementar el software en un sistema equipado con un procesador Nios® II o un sistema integrado en chip (recomendado).
Funciones
- Transformaciones y rotaciones arbitrarias de deformación
- Interfaz de memoria externa altamente optimizada
- Escalamiento local de 0,5x a 2x
- Interpolación bicubic de alta calidad por pixel
- Conjuntos de coeficientes disponibles para lograr la máxima calidad de filtros
- Carga completa de datos para se opere la información entrante y saliente en dominios de reloj independientes
- Compatible con componentes de 10 bits por color
- Compatible con hasta 2 píxeles en paralelo por procesamiento según reloj
- Baja latencia
- Compatible con resoluciones de hasta 3840 × 2160 a 60 fps y compatibilidad futura con hasta 8K a 60 fps.
- Uso bajo de recursos de FPGA
- Interfaz de E/S de video AXI4-Stream
- Convertidores de protocolo de la interfaz de transmisión AXI4-Stream ↔ Avalon*
- Interfaces de control y memoria de la CPU con mapeo de memoria Avalon*
Parámetros de calidad de PI
Aspectos básicos |
|
|---|---|
El año en que se lanzó por primera la PI |
2021 |
Compatible con la versión más reciente del software de diseño Intel® Quartus® |
21.3 |
Estado |
Producción |
Entregas |
|
Las entregas para el cliente son las siguientes: Archivo de diseño (código fuente cifrado o lista de conexiones post-síntesis) Limitaciones de tiempo o diseño Guía del usuario |
Sí |
Cualquier producto adicional Para los clientes provistos con IP |
Ejemplo de banco de pruebas y diseño |
GUI de parametrización que permite al usuario final configurar IP |
Sí |
Se habilitó el núcleo de PI que facilita la asistencia para el modo de evaluación de la PI de FPGA Intel® |
Sí |
Idioma de origen |
Verilog |
Idioma de herramienta de prueba |
Verilog |
Se proporcionan los controladores del software |
Sí |
Asistencia de SO para controladores |
Sin software instalado |
Implementación |
|
Interfaz de usuario |
Protocolo de transmisión de video para FPGA Intel®, mapeo de memoria Avalon* para Intel |
metadatos IP-XACT |
No |
Verificación |
|
Compatible con simuladores |
VCS, VCS MX, Active-HDL, Riviera-PRO, Xcelium, Questa-Intel® FPGA Edition, Questa |
Hardware validado |
Intel® Arria® 10 GX |
Se realizaron pruebas de cumplimiento estándares en el sector |
No |
De ser así, ¿cuáles? |
N/C |
De ser así, ¿en cuál de los dispositivos FPGA Intel®? |
N/C |
De ser así, fecha de cuándo se realizó |
N/C |
De no ser así, ¿se planificó? |
N/C |
Interoperabilidad |
|
Se realizaron pruebas de interoperabilidad en la PI |
Sí |
De ser así, ¿en qué dispositivos FPGA Intel®? |
Intel® Cyclone® 10, Intel® Arria® 10, Intel® Stratix® 10, Intel® Agilex™ |
Hay informes de interoperabilidad disponibles |
No |
Ejemplo de diseño
Basado en el diseño de conversión de formato de video UHD HDMI 2.0 de Intel® Arria® 10 con un canal de video simplificado y controles adicionales para operar y programar la PI.
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Documentación técnica
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