Turbo Intel® FPGA IP

Los códigos de canal con corrección de errores hacia delante (FEC) suelen mejorar la eficiencia energética de los sistemas de comunicación inalámbrica. Los códigos Turbo son los adecuados para comunicaciones móviles 3G y 4G, y para comunicaciones vía satélite. Puede utilizar códigos Turbo en otras aplicaciones que requieran una transferencia de información confiable a través de enlaces de comunicación con ancho de banda o latencia limitados en presencia de ruido que corrompe datos. La 4G Turbo-V Intel® FPGA IP incluye Turbo Intel® FPGA IP y un acelerador de enlace descendente y ascendente para vRAN.

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Guía del usuario de Turbo-V Intel® FPGA IP ›

Turbo Intel® FPGA IP

Descripción general de los aceleradores de enlace descendente y ascendente de Turbo-V Intel® FPGA IP.

Características del producto

Funcionalidad de la IP (acelerador de enlace descendente)

  • Adjunto de código de redundancia cíclica (CRC) del bloque de código
  • Codificador Turbo
  • Coincidencia de tasas con lo siguiente:
    • Intercalador de subbloques
    • Recolector de bits
    • Selector de bits
    • Recortador de bits
  • Añade redundancia a los datos en forma de información de paridad

Funcionalidad de la IP (acelerador de enlace ascendente)

  • Desintercalador de subbloques
  • Decodificador Turbo con comprobación de CRC
  • Aprovecha la redundancia para corregir una cantidad razonable de errores de canal

Especificaciones de desempeño

  • En conformidad con 3GPP LTE y compatible con tamaños de bloque de 40 a 6144

Interfaces de usuario y del sistema

  • Interfaces de entrada y salida de Avalon® Streaming (Avalon-ST)

Funciones de depuración y prueba

  • Proporciona modelos de precisión de bits C y MATLAB para la simulación del desempeño y la generación de vectores de prueba RTL
  • Testbench y diseño de ejemplo disponibles

Estado de IP

Códigos de pedido Estado
Turbo: IP-TURBO Producción
Turbo-V: IP-TURBOV Producción
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Recursos adicionales

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