Operador de mapeo tonal de Intel® FPGA IP
El Tone Mapping Operator (TMO) de Intel® FPGA IP corrige imágenes y video mal expuestos para revelar detalles invisibles.
Notas sobre el producto TMO de Intel® FPGA IP ›
Guía del usuario de la suite de procesamiento de video y visión Intel® FPGA IP ›
Especificación del protocolo de transmisión de video para FPGA Intel® ›
Operador de mapeo tonal de Intel® FPGA IP
Descripción general
El TMO Intel® FPGA IP modifica el contraste de una transmisión de video para mejorar la visibilidad de una gran variedad de aplicaciones, como las imágenes médicas, las videoconferencias, la proyección con luz diurna, las cámaras de seguridad y la visión de máquinas. La PI se basa en cuadros para abarcar las variaciones de exposición locales, lo que permite mejorar la visibilidad de los detalles de las imágenes latentes para mejorar y facilitar la experiencia de visualización general. El núcleo de PI de TMO es compatible con la entrada de video en formato RGB como AXI4-Stream, analiza de forma estadística la luminancia de las imágenes (en lo local y general) y ajusta los componentes de las imágenes de manera dinámica para mejorar su contraste general. Estas operaciones permiten mejorar las imágenes con poca y mucha exposición para utilizar el rango dinámico disponible por completo. La PI de TMO requiere un procesador externo, como el procesador softcore Nios® II para FPGA, a fin de configurar los bloques de PI de TMO y tomar mediciones a través del bus de registro.
Funciones
- Análisis estadístico de imágenes locales con varios cuadros
- Compatibilidad con 8, 10 y 12 bits por componente de color
- Compatible con hasta 4 píxeles en paralelo por procesamiento según reloj
- Latencia baja de subfotogramas (~100 ciclos de reloj)
- Compatible con resoluciones de hasta 4K a 60 fps en las FPGA Intel® C10/A10/S10 y hasta 8K a 60 fps en las FPGA Intel® Agilex™
- Uso bajo de recursos de FPGA
- Interfaz de E/S de video AXI4-Stream
- Convertidores de protocolo de la interfaz de transmisión AXI4-Stream ↔ Avalon*
- Interfaces de control y memoria de la CPU con mapeo de memoria Avalon*
Parámetros de calidad de PI
Aspectos básicos |
|
|---|---|
El año en que se lanzó por primera la PI |
2021 |
Compatible con la versión más reciente del software de diseño Intel® Quartus® |
21.3 |
Estado |
Producción |
Entregas |
|
Las entregas para el cliente son las siguientes:
|
Sí |
Cualquier producto adicional Para los clientes provistos con IP |
Ejemplo de banco de pruebas y diseño |
GUI de parametrización que permite al usuario final configurar IP |
Sí |
Se habilitó el núcleo de PI que facilita la asistencia para el modo de evaluación de la PI de FPGA Intel® |
Sí |
Idioma de origen |
Verilog |
Idioma de herramienta de prueba |
Verilog |
Se proporcionan los controladores del software |
Sí |
Asistencia de SO para controladores |
Sin software instalado |
Implementación |
|
Interfaz de usuario |
Protocolo de transmisión de video para Intel® FPGA, mapeo de memoria Avalon* para Intel |
metadatos IP-XACT |
No |
Verificación |
|
Compatible con simuladores |
VCS, VCS MX, Active-HDL, Riviera-PRO, Xcelium, Questa-Intel® FPGA Edition, Questa |
Hardware validado |
Intel® Arria® 10 GX |
Se realizaron pruebas de cumplimiento estándares en el sector |
No |
De ser así, ¿cuáles? |
N/C |
De ser así, ¿en cuál de los dispositivos FPGA Intel®? |
N/C |
De ser así, fecha de cuándo se realizó |
N/C |
De no ser así, ¿se planificó? |
N/C |
Interoperabilidad |
|
Se realizaron pruebas de interoperabilidad en la PI |
Sí |
De ser así, ¿en qué dispositivos FPGA Intel®? |
Intel® Cyclone® 10, Intel® Arria® 10, Intel® Straitix® 10, Intel® Agilex™ |
Hay informes de interoperabilidad disponibles |
No |
Ejemplo de diseño
Basado en el diseño de conversión de formato de video UHD HDMI 2.0 de Intel® Arria® 10 con un canal de video simplificado y controles adicionales para operar y programar la PI.
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