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  5. Reed-Solomon Compiler IP Core

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Reed-Solomon Compiler IP Core

Reed-Solomon (RS) compiler ofrece un codificador y un decodificador RS con parametrización completa. Los codificadores/decodificadores RS (CODECs) se utilizan en gran medida en la detección y corrección de errores en una gran variedad de aplicaciones de procesamiento de señal digital (DSP) para el almacenamiento, la recuperación y la transmisión de datos.

Lea la guía del usuario de Reed-Solomon compiler ›

Reed-Solomon Compiler IP Core

  • Descripción general

Aviso: Reed-Solomon IP Core está en desuso en la actualidad. Para obtener más detalles, consulte el Anuncio de retirada de productos PDN1410.

Funciones

RS Compiler tiene las siguientes opciones:

  • Opción de compatibilidad con borrado: El decodificador RS puede corregir errores de símbolos hasta la cantidad de símbolos de verificación si se le indica al decodificador la ubicación de los errores.
  • Codificación o decodificación variable: Cuando esté codificando o decodificando, puede variar la cantidad total de símbolos por código y la cantidad de símbolos de verificación en tiempo real desde los valores mínimos permitidos hasta los valores seleccionados.
  • Salida de símbolos de error: El decodificador RS encuentra los valores de error y su ubicación, y agrega estos valores en el campo de Galois del valor de entrada.
  • Salida de error de bits: realiza un conteo dividido o completo

RS Compiler genera una función RS con parametrización completa, lo que le permite configurar los siguientes parámetros:

  • Cantidad de bits por símbolo
  • Cantidad de símbolos por código
  • Cantidad de símbolos de verificación por código
  • Polinomio de campo
  • Primera raíz del polinomio generador
  • Espacio entre las raíces en el polinomio generador

Además, la función RS ofrece las siguientes características:

  • Características de decodificador:
  • Opción variable
  • Opción de compatibilidad con borrado
  • El codificador cuenta con arquitecturas variables
  • Compatibilidad con códigos abreviados
  • Cumple con las recomendaciones del Comité Consultivo en Sistemas de Datos Espaciales (CCSDS) sobre la codificación de canales de telemetría de mayo del 1999
  • Modelos de simulación funcional de propiedad intelectual (PI) para usar en simuladores VHDL y HDL Verilog compatibles con las FPGAs Intel®
  • Interfaz de banco de herramientas de PI fácil de utilizar:
  • Genera un codificador o un decodificador parametrizado
  • Genera un banco de prueba y un script de Tcl personalizados
  • Listo para utilizar con DSP Builder for Intel® FPGAs

Enlaces relacionados

Asistencia para dispositivos

  • Guía del usuario de Reed-Solomon compiler
  • Ver la documentación
  • Notas de la versión de Intel® FPGA IP

Recursos adicionales

Encontrar PI

Encuentre el núcleo de propiedad intelectual Altera® FPGA adecuado para sus necesidades.

Asistencia técnica

Para obtener asistencia técnica sobre este núcleo de PI, visite Recursos de asistencia o Asistencia técnica Premier Intel®. También puede buscar temas relacionados con esta función en el Centro de conocimiento y en las Comunidades.

Evaluación y compra de PI

Información sobre el modo de evaluación y la compra para núcleos de propiedad intelectual Altera® FPGA.

IP Base Suite

Licencias gratuitas para Altera® FPGA IP Core con una licencia activa para el software Quartus® Prime Standard o Pro Edition.

Ejemplos de diseño

Descargue ejemplos de diseño y diseños de referencia para dispositivos Altera® FPGA.

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Póngase en contacto con el departamento de ventas para cubrir sus necesidades de diseño y aceleración con productos FPGA Altera®.

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