LDPC Intel® FPGA IP
Intel está descontinuando la propiedad intelectual (IP) de LDPC. Puede encontrar más información en la notificación de descontinuación del producto (PDN2208).
LDPC Intel® FPGA IP
Comprobación de paridad de baja densidad 5G
Los códigos de comprobación de paridad de baja densidad (LDPC) son códigos de corrección de errores lineales que le permiten transmitir mensajes a través de canales con ruido. El núcleo de propiedad intelectual (PI) de comprobación de paridad de baja densidad (LDPC) 5G Intel® FPGA es un codificador o decodificador de alto rendimiento que satisface la especificación 5G Proyecto de Asociación de Tercera Generación (3GPP). Los códigos de LDPC ofrecen una mejor eficiencia espectral y son compatibles con el alto rendimiento de la nueva radio (NR) 5G. Gracias a la flexibilidad de las Intel® FPGA se pueden diseñar. implementar y rediseñar varias configuraciones para admitir cualquier cambio en el gráfico base, la tasa de códigos y el ancho LR y Z.
Funciones
DOCSIS 3.1 |
Decodificador. Conmutación al instante entre códigos |
|---|---|
WiMedia 1.5 |
Codificador/decodificador Longitud de código variable Conmutación al instante opcional entre códigos Compatible con fotogramas largos y cortos |
DVB-S2 |
Codificador |
NASA |
Codificador/decodificador (conforme con CCSDS) Arquitectura opcional con menor uso de recursos disponible Decodificación de MSA o MSA en capas |
Modelos de precisión de bits MATLAB* para simulación |
|
Todos los decodificadores tienen las siguientes características:
- Modelos MATLAB*
- Arquitectura de doble carga para reducir la latencia y aumentar el rendimiento
- Criterio de detención anticipado
- Parámetros para:
- Paralelismo de entrada
- Paralelismo de decodificación
- Ancho LLR
- Factor de atenuación
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