FPGA de SoC Cyclone® V SE
Cyclone® V SE FPGA está optimizada para un bajo costo y consumo de energía del sistema con el sistema de procesador ARM® Cortex-A9® MPCore integrado para aplicaciones de transceptor de 614 Mbps a 3,125 Gbps.
FPGA de SoC Cyclone® V SE
Beneficios
Haga más con menos energía, tiempo de diseño y costo
Construida sobre la tecnología de proceso de bajo consumo (28LP) de 28 nm de TSMC, que incluye una gran cantidad de bloques de propiedad intelectual (IP) duros, lo que le permite diferenciarse y hacer más.
Capacidades de integración y diferenciación lógica
Ofrece un módulo lógico adaptativo (ALM) de ocho entradas y bloques de procesamiento de señales digitales (DSP) de precisión variable, lo que permite hasta 13,59 megabits (Mb) de memoria integrada.
Sistema de procesador físico (HPS) con procesador ARM® Cortex-A9® MPCore integrado
Estrecha integración de un procesador ARM® Cortex-A9® MPCore de doble núcleo, IP dura y una FPGA en un solo sistema en un chip (SoC) de Cyclone® V. Admite más de 128 Gbps de ancho de banda máximo con coherencia de datos integrada entre el procesador y la estructura FPGA.
Aplicaciones
Eficiencia energética para unidades de próxima generación
Aborda la complejidad y los requisitos de desempeño: bucles de control rápidos; DSP y desempeño computacional, admite múltiples protocolos de Ethernet industrial (IE), escalabilidad para control de múltiples ejes y sistemas de accionamiento integrados. Mejora el tiempo de comercialización a través de la escalabilidad, la flexibilidad y la reutilización del hardware y el diseño, y respalda el flujo de herramientas y la IP de seguridad funcional: ahorra hasta 24 meses en el proceso de certificación de seguridad.
Circuito cerrado de vigilancia televisiva IP
Capaz de manejar la interfaz del sensor (sin pegamento para conectividad paralela o serie de alta velocidad), toda la tubería del sensor de imagen o ISP, el procesamiento de imágenes único para sensores CMOS de amplio rango dinámico, control de motor optimizado para panorámica e inclinación, compresión de video en chip, escalado, análisis, controladores Ethernet y la capacidad de conectarse a codificadores fuera de chip o dispositivos PHY para la transmisión, mercados de cámaras analógicas o IP.
Cámara IP de alta definición (HD)
Cámaras IP HD de futura generación para llevar la integración de DSP (procesamiento de imágenes) y FPGA (análisis de video HD) en un solo chip de FPGA SoC proporcionando análisis de video HD 1080p con amplio rango dinámico. El análisis de video HD podría ejecutarse en uno de los núcleos ARM con lógica adicional en el tejido FPGA. En este caso, se agrega un amplio rango dinámico al procesamiento de la señal de imagen en el SoC FPGA.
Características principales
Bloques de memoria integrados
- M10K: bloques de memoria de 10 kilobits (Kb) con código de corrección de errores suaves (ECC).
- Memory logic array block (MLAB): LUTRAM distribuido de 640 bits donde se puede utilizar hasta el 25 % de los ALMs como memoria MLAB.
E/S de propósito general
- Receptor de señalización diferencial de baja tensión (LVDS) de 875 megabits por segundo (Mbps) y transmisor LVDS de 840 Mbps.
- Interfaz de memoria externa de 400 MHz/800 Mbps.
- Terminación en chip (OCT).
- Soporte de 3,3 V con una potencia de unidad de hasta 16 mA.
Interfaz de memoria externa
En los dispositivos de sistema integrado en chip Cyclone® V, un controlador de memoria física adicional en el HPS admite dispositivos DDR3, DDR2 y LPDDR2 SDRAM.
Sistema de procesador físico (HPS)
El HPS consiste en un procesador Arm* Cortex* -A9 MPCore* de doble núcleo, un amplio conjunto de periféricos y un controlador de memoria SDRAM multipuerto compartido.
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