Guía de usuario de Arria® V GZ Hard IP para PCI Express*

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Arria® V FPGAs and SoC FPGAs Support Arria® V FPGAs and SoC FPGAs Support

654840
2013-07-03
Public

Descripción

Muestra cómo crear una instancia de un puerto raíz o un punto final de IP físico en un FPGA Arria® V GZ. También proporciona un banco de pruebas DMA de encadenamiento y un diseño de ejemplo.

Instrucciones de uso